1、電子類公司筆試題精選（包括 模擬電路、數字電路、ic基礎、數字電路、微機、信號與系統、嵌入式）2008-02-04 12:38數字電路1、同步電路和異步電路的區別是什么？（仕蘭微電子）2、什么是同步邏輯和異步邏輯？（漢王筆試）同步邏輯是時鐘之間有固定的因果關系。異步邏輯是各時鐘之間沒有固定的因果關系。3、什么是線與邏輯，要實現它，在硬件特性上有什么具體要求？（漢王筆試）線與邏輯是兩個輸出信號相連可以實現與的功能。在硬件上，要用oc門來實現，由于不用oc門可能使灌電流過大，而燒壞邏輯門。同時在輸出端口應加一個上拉電阻。4、什么是setup 和holdup時間？（漢王筆試）5、setup和hold

2、up時間,區別.（南山之橋）6、解釋setup time和hold time的定義和在時鐘信號延遲時的變化。（未知）7、解釋setup和hold time violation，畫圖說明，并說明解決辦法。（威盛via2003.11.06 上海筆試試題）setup/hold time 是測試芯片對輸入信號和時鐘信號之間的時間要求。建立時間是指觸發器的時鐘信號上升沿到來以前，數據穩定不變的時間。輸入信號應提前時鐘上升沿（如上升沿有效）t時間到達芯片，這個t就是建立時間-setup time.如不滿足setup time,這個數據就不能被這一時鐘打入觸發器，只有在下一個時鐘上升沿，數據才能被打入觸發器

3、。保持時間是指觸發器的時鐘信號上升沿到來以后，數據穩定不變的時間。如果hold time不夠，數據同樣不能被打入觸發器。建立時間(setup time)和保持時間（hold time）。建立時間是指在時鐘邊沿前，數據信號需要保持不變的時間。保持時間是指時鐘跳變邊沿后數據信號需要保持不變的時間。如果不滿足建立和保持時間的話，那么dff將不能正確地采樣到數據，將會出現metastability的情況。如果數據信號在時鐘沿觸發前后持續的時間均超過建立和保持時間，那么超過量就分別被稱為建立時間裕量和保持時間裕量。8、說說對數字邏輯中的競爭和冒險的理解，并舉例說明競爭和冒險怎樣消除。（仕蘭微電子）9、什

4、么是競爭與冒險現象？怎樣判斷？如何消除？（漢王筆試）在組合邏輯中，由于門的輸入信號通路中經過了不同的延時，導致到達該門的時間不一致叫競爭。產生毛刺叫冒險。如果布爾式中有相反的信號則可能產生競爭和冒險現象。解決方法：一是添加布爾式的消去項，二是在芯片外部加電容。10、你知道那些常用邏輯電平？ttl與coms電平可以直接互連嗎？（漢王筆試）常用邏輯電平：12v，5v，3.3v；ttl和cmos不可以直接互連，由于ttl是在0.3-3.6v之間，而cmos則是有在12v的有在5v的。cmos輸出接到ttl是可以直接互連。ttl接到cmos需要在輸出端口加一上拉電阻接到5v或者12v。11、如何解決亞

5、穩態。（飛利浦大唐筆試）亞穩態是指觸發器無法在某個規定時間段內達到一個可確認的狀態。當一個觸發器進入亞穩態時，既無法預測該單元的輸出電平，也無法預測何時輸出才能穩定在某個正確的電平上。在這個穩定期間，觸發器輸出一些中間級電平，或者可能處于振蕩狀態，并且這種無用的輸出電平可以沿信號通道上的各個觸發器級聯式傳播下去。12、ic設計中同步復位與 異步復位的區別。（南山之橋）13、moore 與 meeley狀態機的特征。（南山之橋）14、多時域設計中,如何處理信號跨時域。（南山之橋）15、給了reg的setup,hold時間，求中間組合邏輯的delay范圍。（飛利浦大唐筆試）delay q,還有 c

6、lock的delay,寫出決定最大時鐘的因素，同時給出表達式。（威盛via 2003.11.06 上海筆試試題）18、說說靜態、動態時序模擬的優缺點。（威盛via 2003.11.06 上海筆試試題）19、一個四級的mux,其中第二級信號為關鍵信號如何改善timing。（威盛via2003.11.06 上海筆試試題）20、給出一個門級的圖，又給了各個門的傳輸延時，問關鍵路徑是什么，還問給出輸入，使得輸出依賴于關鍵路徑。（未知）21、邏輯方面數字電路的卡諾圖化簡，時序（同步異步差異），觸發器有幾種（區別，優點），全加器等等。（未知）22、卡諾圖寫出邏輯表達使。（威盛via 2003.11.06

7、上海筆試試題）23、化簡f(a,b,c,d)= m(1,3,4,5,10,11,12,13,14,15)的和。（威盛）24、please show the cmos inverter schmatic,layout and its cross sectionwith p-well process.plot its transfer curve (vout-vin) and also explain theoperation region of pmos and nmos for each segment of the transfer curve? （威盛筆試題circuit design-b

8、eijing-03.11.09）25、to design a cmos invertor with balance rise and fall time,please definethe ration of channel width of pmos and nmos and explain?26、為什么一個標準的倒相器中p管的寬長比要比n管的寬長比大？（仕蘭微電子）27、用mos管搭出一個二輸入與非門。（揚智電子筆試）28、please draw the transistor level schematic of a cmos 2 input and gate andexplain whic

9、h input has faster response for output rising edge.(less delaytime)。（威盛筆試題circuit design-beijing-03.11.09）29、畫出not,nand,nor的符號，真值表，還有transistor level的電路。（infineon筆試）30、畫出cmos的圖，畫出tow-to-one mux gate。（威盛via 2003.11.06 上海筆試試題）31、用一個二選一mux和一個inv實現異或。（飛利浦大唐筆試）32、畫出y=a*b+c的cmos電路圖。（科廣試題）33、用邏輯們和cmos電路實現a

10、b+cd。（飛利浦大唐筆試）34、畫出cmos電路的晶體管級電路圖，實現y=a*b+c(d+e)。（仕蘭微電子）35、利用4選1實現f(x,y,z)=xz+yz。（未知）36、給一個表達式f=xxxx+xxxx+xxxxx+xxxx用最少數量的與非門實現（實際上就是化簡）。37、給出一個簡單的由多個not,nand,nor組成的原理圖，根據輸入波形畫出各點波形。（infineon筆試）38、為了實現邏輯（a xor b）or （c and d），請選用以下邏輯中的一種，并說明為什么？1）inv 2）and 3）or 4）nand 5）nor 6）xor 答案：nand（未知）39、用與非門等設

11、計全加法器。（華為）40、給出兩個門電路讓你分析異同。（華為）41、用簡單電路實現，當a為輸入時，輸出b波形為（仕蘭微電子）42、a,b,c,d,e進行投票，多數服從少數，輸出是f（也就是如果a,b,c,d,e中1的個數比0多，那么f輸出為1，否則f為0），用與非門實現，輸入數目沒有限制。（未知）43、用波形表示d觸發器的功能。（揚智電子筆試）44、用傳輸門和倒向器搭一個邊沿觸發器。（揚智電子筆試）45、用邏輯們畫出d觸發器。（威盛via 2003.11.06 上海筆試試題）46、畫出dff的結構圖,用verilog實現之。（威盛）47、畫出一種cmos的d鎖存器的電路圖和版圖。（未知）48、

12、d觸發器和d鎖存器的區別。（新太硬件面試）49、簡述latch和filp-flop的異同。（未知）50、latch和dff的概念和區別。（未知）51、latch與register的區別,為什么現在多用register.行為級描述中latch如何產生的。（南山之橋）52、用d觸發器做個二分顰的電路.又問什么是狀態圖。（華為）53、請畫出用d觸發器實現2倍分頻的邏輯電路？（漢王筆試）54、怎樣用d觸發器、與或非門組成二分頻電路？（東信筆試）55、how many flip-flop circuits are needed to divide by 16? (intel) 16分頻？56、用filp

13、-flop和logic-gate設計一個1位加法器，輸入carryin和current-stage，輸出carryout和next-stage. （未知）57、用d觸發器做個4進制的計數。（華為）58、實現n位johnson counter,n=5。（南山之橋）59、用你熟悉的設計方式設計一個可預置初值的7進制循環計數器，15進制的呢？（仕蘭微電子）60、數字電路設計當然必問verilog/vhdl，如設計計數器。（未知）61、blocking nonblocking 賦值的區別。（南山之橋）62、寫異步d觸發器的verilog module。（揚智電子筆試）模擬電路1基爾霍夫定理的內容是什么

14、？（仕蘭微電子）基爾霍夫電流定律是一個電荷守恒定律,即在一個電路中流入一個節點的電荷與流出同一個節點的電荷相等.基爾霍夫電壓定律是一個能量守恒定律,即在一個回路中回路電壓之和為零.2、平板電容公式(c=s/4kd)。（未知）3、最基本的如三極管曲線特性。（未知）4、描述反饋電路的概念，列舉他們的應用。（仕蘭微電子）5、負反饋種類（電壓并聯反饋，電流串聯反饋，電壓串聯反饋和電流并聯反饋）；負反饋的優點（降低放大器的增益靈敏度，改變輸入電阻和輸出電阻，改善放大器的線性和非 線性失真，有效地擴展放大器的通頻帶，自動調節作用）（未知）6、放大電路的頻率補償的目的是什么，有哪些方法？（仕蘭微電子）7、頻

15、率響應，如：怎么才算是穩定的，如何改變頻響曲線的幾個方法。（未知）8、給出一個查分運放，如何相位補償，并畫補償后的波特圖。（凹凸）9、基本放大電路種類（電壓放大器，電流放大器，互導放大器和互阻放大器），優缺點，特別是廣泛采用差分結構的原因。（未知）10、給出一差分電路，告訴其輸出電壓y 和y-,求共模分量和差模分量。（未知）11、畫差放的兩個輸入管。（凹凸）12、畫出由運放構成加法、減法、微分、積分運算的電路原理圖。并畫出一個晶體管級的運放電路。（仕蘭微電子）13、用運算放大器組成一個10倍的放大器。（未知）14、給出一個簡單電路，讓你分析輸出電壓的特性（就是個積分電路），并求輸出端某點的ri

16、se/fall時間。(infineon筆試試題)15、電阻r和電容c串聯，輸入電壓為r和c之間的電壓，輸出電壓分別為c上電壓和r上電壓，要求制這兩種電路輸入電壓的頻譜，判斷這兩種電路何為高通濾波器，何為低通濾波器。當rcq,還有 clock的delay,寫出決定最大時鐘的因素，同時給出表達式。（威盛via 2003.11.06 上海筆試試題）18、說說靜態、動態時序模擬的優缺點。（威盛via 2003.11.06 上海筆試試題）19、一個四級的mux,其中第二級信號為關鍵信號 如何改善timing。（威盛via2003.11.06上海筆試試題）20、給出一個門級的圖，又給了各個門的傳輸延時，問

17、關鍵路徑是什么，還問給出輸入，使得輸出依賴于關鍵路徑。（未知）21、邏輯方面數字電路的卡諾圖化簡，時序（同步異步差異），觸發器有幾種（區別，優點），全加器等等。（未知）22、卡諾圖寫出邏輯表達使。（威盛via 2003.11.06 上海筆試試題）23、化簡f(a,b,c,d)= m(1,3,4,5,10,11,12,13,14,15)的和。（威盛）24、please show the cmos inverter schmatic,layout and its cross sectionwith p-well process.plot its transfer curve (vout-vin)

18、and also explain the operationregion of pmos and nmos for each segment of the transfer curve? （威盛筆試題circuit design-beijing-03.11.09）25、to design a cmos invertor with balance rise and fall time,please define the ration of channel of pmos and nmos and explain?26、為什么一個標準的倒相器中p管的寬長比要比n管的寬長比大？（仕蘭微電子）27、用

19、mos管搭出一個二輸入與非門。（揚智電子筆試）28、please draw the transistor level schematic of a cmos 2 input and gate andexplain which input has faster res0824ponse for output rising edge.(less delaytime)。（威盛筆試題circuit design-beijing-03.11.09）29、畫出not,nand,nor的符號，真值表，還有transistor level的電路。（infineon筆試）30、畫出cmos的圖，畫出tow-to

20、-one mux gate。（威盛via 2003.11.06 上海筆試試題）31、用一個二選一mux和一個inv實現異或。（飛利浦大唐筆試）32、畫出y=a*b c的cmos電路圖。（科廣試題）33、用邏輯們和cmos電路實現ab cd。（飛利浦大唐筆試）34、畫出cmos電路的晶體管級電路圖，實現y=a*b c(d e)。（仕蘭微電子）35、利用4選1實現f(x,y,z)=xz yz。（未知）36、給一個表達式f=xxxx xxxx xxxxx xxxx用最少數量的與非門實現（實際上就是化簡）。37、給出一個簡單的由多個not,nand,nor組成的原理圖，根據輸入波形畫出各點波形。（in

21、fineon筆試）38、為了實現邏輯（a xor b）or （c and d），請選用以下邏輯中的一種，并說明為什么？1）inv 2）and 3）or 4）nand 5）nor 6）xor 答案：nand（未知）39、用與非門等設計全加法器。（華為）40、給出兩個門電路讓你分析異同。（華為）41、用簡單電路實現，當a為輸入時，輸出b波形為（仕蘭微電子）42、a,b,c,d,e進行投票，多數服從少數，輸出是f（也就是如果a,b,c,d,e中1的個數比0多，那么f輸出為1，否則f為0），用與非門實現，輸入數目沒有限制。（未知）43、用波形表示d觸發器的功能。（揚智電子筆試）44、用傳輸門和倒向器搭

22、一個邊沿觸發器。（揚智電子筆試）45、用邏輯們畫出d觸發器。（威盛via 2003.11.06 上海筆試試題）46、畫出dff的結構圖,用verilog實現之。（威盛）47、畫出一種cmos的d鎖存器的電路圖和版圖。（未知）48、d觸發器和d鎖存器的區別。（新太硬件面試）49、簡述latch和filp-flop的異同。（未知）50、latch和dff的概念和區別。（未知）51、latch與register的區別,為什么現在多用register.行為級描述中latch如何產生的。（南山之橋）52、用d觸發器做個二分顰的電路.又問什么是狀態圖。（華為）53、請畫出用d觸發器實現2倍分頻的邏輯電路？

23、（漢王筆試）54、怎樣用d觸發器、與或非門組成二分頻電路？（東信筆試）55、how many flip-flop circuits are needed to divide by 16? (intel) 16分頻？56、用filp-flop和logic-gate設計一個1位加法器，輸入carryin和current-stage，輸出carryout和next-stage. （未知）57、用d觸發器做個4進制的計數。（華為）58、實現n位johnson counter,n=5。（南山之橋）59、用你熟悉的設計方式設計一個可預置初值的7進制循環計數器，15進制的呢？（仕蘭微電子）60、數字電路設計

24、當然必問verilog/vhdl，如設計計數器。（未知）61、blocking nonblocking 賦值的區別。（南山之橋）62、寫異步d觸發器的verilog module。（揚智電子筆試）module dff8(clk , res0824et, d, q);input clk;input res0824et;input 7:0 d;output 7:0 q;reg 7:0 q;always (posedge clk or posedge res0824et)if(res0824et)q = 0;elseq = d;endmodule63、用d觸發器實現2倍分頻的verilog描述？ （

25、漢王筆試）module divide2( clk , clk_o, res0824et);input clk , res0824et;output clk_o;wire in;reg out ;always ( posedge clk or posedge res0824et)if ( res0824et)out = 0;elseout = in;assign in = out;assign clk_o = out;endmodule64、可編程邏輯器件在現代電子設計中越來越重要，請問：a) 你所知道的可編程邏輯器件有哪些？ b) 試用vhdl或verilog、able描述8位d觸發器邏輯。（

26、漢王筆試）pal，pld，cpld，fpga。module dff8(clk , res0824et, d, q);input clk;input res0824et;input d;output q;reg q;always (posedge clk or posedge res0824et)if(res0824et)q = 0;elseq = d;endmodule65、請用hdl描述四位的全加法器、5分頻電路。（仕蘭微電子）66、用verilog或vhdl寫一段代碼，實現10進制計數器。（未知）67、用verilog或vhdl寫一段代碼，實現消除一個glitch。（未知）68、一個狀態機

27、的題目用verilog實現（不過這個狀態機畫的實在比較差，很容易誤解的）。（威盛via 2003.11.06 上海筆試試題）69、描述一個交通信號燈的設計。（仕蘭微電子）70、畫狀態機，接受1，2，5分錢的賣報機，每份報紙5分錢。（揚智電子筆試）71、設計一個自動售貨機系統，賣soda水的，只能投進三種硬幣，要正確的找回錢數。（1）畫出fsm（有限狀態機）；（2）用verilog編程，語法要符合fpga設計的要求。（未知）72、設計一個自動飲料售賣機，飲料10分錢，硬幣有5分和10分兩種，并考慮找零：（1）畫出fsm（有限狀態機）；（2）用verilog編程，語法要符合fpga設計的要求；（3

28、）設計工程中可使用的工具及設計大致過程。（未知）73、畫出可以檢測10010串的狀態圖,并verilog實現之。（威盛）74、用fsm實現101101的序列檢測模塊。（南山之橋）a為輸入端，b為輸出端，如果a連續輸入為1101則b輸出為1，否則為0。例如a： 0001100110110100100110b： 0000000000100100000000請畫出state machine；請用rtl描述其state machine。（未知）75、用verilog/vddl檢測stream中的特定字符串（分狀態用狀態機寫）。（飛利浦大唐筆試）76、用verilog/vhdl寫一個fifo控制器(包括

29、空，滿，半滿信號)。（飛利浦大唐筆試）77、現有一用戶需要一種集成電路產品，要求該產品能夠實現如下功能：y=lnx，其中，x為4位二進制整數輸入信號。y為二進制小數輸出，要求保留兩位小數。電源電壓為35v假設公司接到該項目后，交由你來負責該產品的設計，試討論該產品的設計全程。（仕蘭微電子）78、sram，falsh memory，及dram的區別？（新太硬件面試）79、給出單管dram的原理圖(西電版數字電子技術基礎作者楊頌華、馮毛官205頁圖914b)，問你有什么辦法提高refres0824h time，總共有5個問題，記不起來了。（降低溫度，增大電容存儲容量）（infineon筆試）80、

30、please draw schematic of a common sram cell with 6 transistors,point out which nodes can store data and which node is word line control? （威盛筆試題circuit design-beijing-03.11.09）81、名詞:sram,ssram,sdram 名詞irq,bios,usb,vhdl,sdrirq: interrupt request bios: basic input output system usb: universal serial bu

31、svhdl: vhic hardware description language sdr: single data rate壓控振蕩器的英文縮寫(vco)。動態隨機存儲器的英文縮寫(dram)。名詞解釋，無聊的外文縮寫罷了，比如pci、ecc、ddr、interrupt、pipeline irq,bios,usb,vhdl,vlsi vco(壓控振蕩器) ram (動態隨機存儲器)，fir iir dft(離散傅立葉變換)或者是中文的，比如：a.量化誤差 b.直方圖 c.白平衡ic設計基礎（流程、工藝、版圖、器件）1、我們公司的產品是集成電路，請描述一下你對集成電路的認識，列舉一些與集成電路

32、相關的內容（如講清楚模擬、數字、雙極型、cmos、mcu、risc、cisc、dsp、asic、fpga等的概念）。（仕蘭微面試題目）2、fpga和asic的概念，他們的區別。（未知）答案：fpga是可編程asic。asic:專用集成電路，它是面向專門用途的電路，專門為一個用戶設計和制造的。根據一個用戶的特定要求，能以低研制成本，短、交貨周期供貨的全定制，半定制集成電路。與門陣列等其它asic(application specific ic)相比，它們又具有設計開發周期短、設計制造成本低、開發工具先進、標準產品無需測試、質量穩定以及可實時在線檢驗等優點3、什么叫做otp片、掩膜片，兩者的區別何

33、在？（仕蘭微面試題目）4、你知道的集成電路設計的表達方式有哪幾種？（仕蘭微面試題目）5、描述你對集成電路設計流程的認識。（仕蘭微面試題目）6、簡述fpga等可編程邏輯器件設計流程。（仕蘭微面試題目）7、ic設計前端到后端的流程和eda工具。（未知）8、從rtl synthesis到tape out之間的設計flow,并列出其中各步使用的tool.（未知）9、asic的design flow。（威盛via 2003.11.06 上海筆試試題）10、寫出asic前期設計的流程和相應的工具。（威盛）11、集成電路前段設計流程，寫出相關的工具。（揚智電子筆試）先介紹下ic開發流程：1.）代碼輸入（de

34、sign input)用vhdl或者是verilog語言來完成器件的功能描述，生成hdl代碼語言輸入工具：summit visualhdl mentor renior圖形輸入: composer(cadence); viewlogic (viewdraw)2.）電路仿真（circuit simulation)將vhd代碼進行先前邏輯仿真，驗證功能描述是否正確數字電路仿真工具： verolog： cadence verolig-xl synopsys vcs mentor modle-sim vhdl : cadence nc-vhdl synopsys vss mentor modle-sim

35、模擬電路仿真工具： *anti hspice pspice，spectre micro microwave: eesoft : hp3.）邏輯綜合（synthesis tools)邏輯綜合工具可以將設計思想vhd代碼轉化成對應一定工藝手段的門級電路；將初級仿真中所沒有考慮的門沿（gates delay）反標到生成的門級網表中,返回電路仿真階段進行再仿真。最終仿真結果生成的網表稱為物理網表。12、請簡述一下設計后端的整個流程？（仕蘭微面試題目）13、是否接觸過自動布局布線？請說出一兩種工具軟件。自動布局布線需要哪些基本元素？（仕蘭微面試題目）14、描述你對集成電路工藝的認識。（仕蘭微面試題目）1

36、5、列舉幾種集成電路典型工藝。工藝上常提到0.25,0.18指的是什么？（仕蘭微面試題目）16、請描述一下國內的工藝現狀。（仕蘭微面試題目）17、半導體工藝中，摻雜有哪幾種方式？（仕蘭微面試題目）18、描述cmos電路中閂鎖效應產生的過程及最后的結果？（仕蘭微面試題目）19、解釋latch-up現象和antenna effect和其預防措施.（未知）20、什么叫latchup?（科廣試題）21、什么叫窄溝效應? （科廣試題）22、什么是nmos、pmos、cmos？什么是增強型、耗盡型？什么是pnp、npn？他們有什么差別？（仕蘭微面試題目）23、硅柵coms工藝中n阱中做的是p管還是n管，n

37、阱的阱電位的連接有什么要求？（仕蘭微面試題目）24、畫出cmos晶體管的cross-over圖（應該是縱剖面圖），給出所有可能的傳輸特性和轉移特性。（infineon筆試試題）25、以interver為例,寫出n阱cmos的process流程,并畫出剖面圖。（科廣試題）26、please explain how we describe the resistance in semiconductor. comparethe resistance of a metal,poly and diffusion in tranditional cmos process.（威盛筆試題circuit des

38、ign-beijing-03.11.09）27、說明mos一半工作在什么區。（凹凸的題目和面試）28、畫p-bulk 的nmos截面圖。（凹凸的題目和面試）29、寫schematic note（？）， 越多越好。（凹凸的題目和面試）30、寄生效應在ic設計中怎樣加以克服和利用。（未知）31、太底層的mos管物理特性感覺一般不大會作為筆試面試題，因為全是微電子物理，公式推導太羅索，除非面試出題的是個老學究。ic設計的話需要熟悉的軟件: cadence,synopsys, avant，unix當然也要大概會操作。32、unix 命令cp -r, rm,uname。（揚智電子筆試）單片機、mcu、計

39、算機原理1、簡單描述一個單片機系統的主要組成模塊，并說明各模塊之間的數據流流向和控制流流向。簡述單片機應用系統的設計原則。（仕蘭微面試題目）2、畫出8031與2716（2k*8rom）的連線圖，要求采用三-八譯碼器，8031的p2.5,p2.4和p2.3參加譯碼，基本地址范圍為3000h-3fffh。該2716有沒有重疊地址？根據是什么？若有，則寫出每片2716的重疊地址范圍。（仕蘭微面試題目）3、用8051設計一個帶一個8*16鍵盤加驅動八個數碼管（共陽）的原理圖。（仕蘭微面試題目）4、pci總線的含義是什么？pci總線的主要特點是什么？ （仕蘭微面試題目）5、中斷的概念？簡述中斷的過程。（

40、仕蘭微面試題目）6、如單片機中斷幾個/類型，編中斷程序注意什么問題；（未知）7、要用一個開環脈沖調速系統來控制直流電動機的轉速，程序由8051完成。簡單原理如下：由p3.4輸出脈沖的占空比來控制轉速，占空比越大，轉速越快；而占空比由k7-k0八個開關來設置，直接與p1口相連（開關撥到下方時為0，撥到上方時為1，組成一個八位二進制數n），要求占空比為n/256。 （仕蘭微面試題目） 下面程序用計數法來實現這一功能，請將空余部分添完整。 mov p1，#0ffh loop1 ：mov r4，#0ffh - mov r3，#00h loop2 ：mov a，p1 - subb a，r3 jnz sk

41、p1 - skp1：mov c，70h mov p3.4，c acall delay ：此延時子程序略 - - ajmp loop18、單片機上電后沒有運轉，首先要檢查什么？（東信筆試題）9、what is pc chipset? （揚智電子筆試）芯片組（chipset）是主板的核心組成部分，按照在主板上的排列位置的不同，通常分為北橋芯片和南橋芯片。北橋芯片提供對cpu的類型和主頻、內存的類型和最大容量、isa/pci/agp插槽、ecc糾錯等支持。南橋芯片則提供對kbc（鍵盤控制器）、rtc（實時時鐘控制器）、usb（通用串行總線）、ultra dma/33(66)eide數據傳輸方式和ac

42、pi（高級能源管理）等的支持。其中北橋芯片起著主導性的作用，也稱為主橋（host bridge）。除了最通用的南北橋結構外，目前芯片組正向更高級的加速集線架構發展，intel的8xx系列芯片組就是這類芯片組的代表，它將一些子系統如ide接口、音效、modem和usb直接接入主芯片，能夠提供比pci總線寬一倍的帶寬，達到了266mb/s。10、如果簡歷上還說做過cpu之類，就會問到諸如cpu如何工作，流水線之類的問題。（未知）11、計算機的基本組成部分及其各自的作用。（東信筆試題）12、請畫出微機接口電路中，典型的輸入設備與微機接口邏輯示意圖（數據接口、控制接口、所存器/緩沖器）。 （漢王筆試）

43、13、cache的主要部分什么的。（威盛via 2003.11.06 上海筆試試題）14、同步異步傳輸的差異（未知）15、串行通信與同步通信異同,特點,比較。（華為面試題）16、rs232c高電平脈沖對應的ttl邏輯是?(負邏輯?) （華為面試題）信號與系統1、的話音頻率一般為3003400hz，若對其采樣且使信號不失真，其最小的采樣頻率應為多大？若采用8khz的采樣頻率，并采用8bit的pcm編碼，則存儲一秒鐘的信號數據量有多大？（仕蘭微面試題目）2、什么耐奎斯特定律,怎么由模擬信號轉為數字信號。（華為面試題）3、如果模擬信號的帶寬為 5khz,要用8k的采樣率，怎么辦？ (lucent)

44、兩路？4、信號與系統:在時域與頻域關系。（華為面試題）5、給出時域信號，求其直流分量。（未知）6、給出一時域信號，要求（1）寫出頻率分量，（2）寫出其傅立葉變換級數；（3）當波形經過低通濾波器濾掉高次諧波而只保留一次諧波時，畫出濾波后的輸出波形。（未知）7、sketch 連續正弦信號和連續矩形波(都有圖)的傅立葉變換 。（infineon筆試試題）8、拉氏變換和傅立葉變換的表達式及聯系。（新太硬件面題）dsp、嵌入式、軟件等1、請用方框圖描述一個你熟悉的實用數字信號處理系統，并做簡要的分析；如果沒有，也可以自己設計一個簡單的數字信號處理系統，并描述其功能及用途。（仕蘭微面試題目）2、數字濾波器

45、的分類和結構特點。（仕蘭微面試題目）3、iir，fir濾波器的異同。（新太硬件面題）4、拉氏變換與z變換公式等類似東西，隨便翻翻書把如.h(n)=-a*h(n-1)+b*(n) a.求h(n)的z變換；b.問該系統是否為穩定系統；c.寫出fir數字濾波器的差分方程；（未知）5、dsp和通用處理器在結構上有什么不同，請簡要畫出你熟悉的一種dsp結構圖。（信威dsp軟件面試題）6、說說定點dsp和浮點dsp的定義（或者說出他們的區別）（信威dsp軟件面試題）7、說說你對循環尋址和位反序尋址的理解.（信威dsp軟件面試題）8、請寫出【8，7】的二進制補碼，和二進制偏置碼。用q15表示出0.5和0.5

46、.（信威dsp軟件面試題）9、dsp的結構（哈佛結構）；（未知）10、嵌入式處理器類型(如arm)，操作系統種類（vxworks,ucos,wince,linux），操作系統方面偏cs方向了，在cs篇里面講了；（未知）11、有一個ldo芯片將用于對手機供電，需要你對他進行評估，你將如何設計你的測試項目？12、某程序在一個嵌入式系統（200m cpu，50m sdram）中已經最優化了，換到零一個系統（300m cpu，50m sdram）中是否還需要優化？ （intel）13、請簡要描述huffman編碼的基本原理及其基本的實現方法。（仕蘭微面試題目）14、說出osi七層網絡協議中的四層（任意

47、四層）。（仕蘭微面試題目）15、a） （仕蘭微面試題目）i ncludevoid testf(int*p)*p+=1;main()int *n,m2;n=m;m0=1;m1=8;testf(n);printf(data value is %d ,*n);-b)i ncludevoid testf(int*p)*p+=1;main()int *n,m2;n=m;m0=1;m1=8;testf(&n);printf(data value is %d,*n);下面的結果是程序a還是程序b的？data value is 8那么另一段程序的結果是什么？16、那種排序方法最快? （華為面試題）17、寫出兩

48、個排序算法,問哪個好？（威盛）18、編一個簡單的求n!的程序 。（infineon筆試試題）19、用一種編程語言寫n!的算法。（威盛via 2003.11.06 上海筆試試題）20、用c語言寫一個遞歸算法求n！；（華為面試題）21、給一個c的函數，關于字符串和數組，找出錯誤；（華為面試題）22、防火墻是怎么實現的？ （華為面試題）23、你對哪方面編程熟悉？（華為面試題）24、冒泡排序的原理。（新太硬件面題）25、操作系統的功能。（新太硬件面題）26、學過的計算機語言及開發的系統。（新太硬件面題）27、一個農夫發現圍成正方形的圍欄比長方形的節省4個木樁但是面積一樣.羊的數目和正方形圍欄的樁子的個

49、數一樣但是小于36，問有多少羊？（威盛）28、c語言實現統計某個cell在某.v文件調用的次數(這個題目真bt) （威盛via2003.11.06 上海筆試試題）29、用c語言寫一段控制手機中馬達振子的驅動程序。(威勝)30、用perl或tcl/tk實現一段字符串識別和比較的程序。（未知）31、給出一個堆棧的結構，求中斷后顯示結果，主要是考堆棧壓入返回地址存放在低端地址還是高端。（未知）32、一些dos命令，如顯示文件，拷貝，刪除。（未知）33、設計一個類，使得該類任何形式的派生類無論怎么定義和實現，都無法產生任何對象實例。（ibm）34、what is pre-emption? (intel

50、)35、what is the state of a process if a resource is not available? (intel)36、三個 float a,b,c;問值（a+b）+c=(b+a)+c， (a+b)+c=(a+c)+b。(intel)37、把一個鏈表反向填空。 (lucent)38、x4+a*x3+x2+c*x+d 最少需要做幾次乘法？ (dephi)_主觀題1、你認為你從事研發工作有哪些特點？（仕蘭微面試題目）2、說出你的最大弱點及改進方法。（威盛via 2003.11.06 上海筆試試題）3、說出你的理想。說出你想達到的目標。 題目是英文出的，要用英文回答

51、。（威盛via2003.11.06 上海筆試試題）4、我們將研發人員分為若干研究方向，對協議和算法理解（主要應用在網絡通信、圖象語音壓縮方面）、電子系統方案的研究、用mcu、dsp編程實現電路功能、用asic設計技術設計電路（包括mcu、dsp本身）、電路功能模塊設計（包括模擬電路和數字電路）、集成電路后端設計（主要是指綜合及自動布局布線技術）、集成電路設計與工藝接口的研究。你希望從事哪方面的研究？（可以選擇多個方向。另外，已經從事過相關研發的人員可以詳細描述你的研發經歷）。（仕蘭微面試題目）5、請談談對一個系統設計的總體思路。針對這個思路，你覺得應該具備哪些方面的知識？（仕蘭微面試題目）6、

52、設想你將設計完成一個電子電路方案。請簡述用eda軟件（如protel）進行設計（包括原理圖和pcb圖）到調試出樣機的整個過程。在各環節應注意哪些問題？電源的穩定，電容的選取，以及布局的大小。（漢王筆試）共同的注意點1.一般情況下，面試官主要根據你的簡歷提問，所以一定要對自己負責，把簡歷上的東西搞明白；2.個別招聘針對性特別強，就招目前他們確的方向的人，這種情況下，就要投其所好，盡量介紹其所關心的東西。3.其實技術面試并不難，但是由于很多東西都忘掉了，才覺得有些難。所以最好在面試前把該看的書看看。4.雖然說技術面試是實力的較量與體現，但是不可否認，由于不用面試官/公司所專領域及愛好不同，也有面試

53、也有很大的偶然性，需要冷靜對待。不能因為被拒，就否認自己或責罵公司。5.面試時要take it easy，對越是自己鐘情的公司越要這樣。揚智電子筆試（硬件）題目第一題：用mos管搭出一個二輸入與非門。第二題：集成電路前段設計流程，寫出相關的工具。第三題：名詞irq,bios,usb,vhdl,sdr第四題：unix 命令cp -r, rm,uname第五題：用波形表示d觸發器的功能第六題：寫異步d觸發器的verilog module第七題：what is pc chipset?第八題：用傳輸門和倒向器搭一個邊沿觸發器第九題：畫狀態機，接受1，2，5分錢的賣報機，每份報紙5分錢揚智dsp筆試題目

54、1.h(n)=-a*h(n-1)+b*(n)a.求h(n)的z變換b.問該系統是否為穩定系統c.寫出fir數字濾波器的差分方程2.寫出下面模擬信號所需的最小采樣帶寬a.模擬信號的頻率范圍是04khzb.模擬信號的頻率范圍是24khz3.名詞解釋a.量化誤差b.直方圖c.白平衡d.mmx4.寫出下面幾種格式中用到的壓縮技術a.jpegb.mpeg2c.mp3揚智筆試題1.什么是進程(process)和線程(thread),有何區別？2.mfc和sdk有何區別？3.irp是什么，有何作用？4.windows2000操作系統下用戶模式和內核模式下編程有何區別？5.驅動程序的buffer能swap到磁盤上去嗎？為什么？6.試編寫3個函數實現a.建立一個雙向鏈表b.插入一個節點c.刪除一個節點7.hardware interrupt和software中斷的區別，簡述及應用8.試編寫一個函數計算一個字符串中a得個數。9.畫出其相應流程圖并編寫一個函數并實現一個整數到二進制數的轉換如輸入6，輸出110；10a.編寫一個遞歸函數刪除一個目錄b.編寫一個非遞歸函數刪除一個目錄比較其性能附加題簡單敘述編程經歷筆試：c+，考的n基礎，但是不是很好做1) c+中引用編譯過的c代碼為什么要用“extern c”2) 類與struct的區別3）數據庫建表的sql語句，