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1、-作者xxxx-日期xxxx計算機組成原理寄存器實驗【精品文檔】成績：計算機原理實驗室實驗報告課 程 ： 計算機組成原理 姓 名 ： 李文周 專 業 ： 計算機科學與技術學 號 ： 132054237 日 期 ： 太原工業學院計算機工程系【精品文檔】實驗二：寄存器實驗實驗環境PC機Win774LS373proteus仿真器實驗日期1 實驗內容（1）基本內容1.理解CPU運算器中寄存器的作用2.設計并驗證4位算數邏輯單元的功能（2）擴展要求1.實現更多的寄存器（至少8個）二理論分析或算法分析74ls373是常用的地址鎖存器芯片，它實質是一個是帶三態緩沖輸出的8D觸發器，在單片機系統中為了擴展外部

2、存儲器，通常需要一塊74ls373芯片。74ls373工作原理簡述: (1).1腳是輸出使能(OE),是低電平有效,當1腳是高電平時,不管輸入3、4、7、8、13、14、17、18如何,也不管11腳(鎖存控制端,G)如何,輸出2(Q0)、5(Q1)、6(Q2)、9(Q3)、12(Q4)、15(Q5)、16(Q6)、19(Q7)全部呈現高阻狀態(或者叫浮空狀態); (2).當1腳是低電平時,只要11腳(鎖存控制端,G)上出現一個下降沿,輸出2(Q0)、5(Q1)、6(Q2)、9(Q3)、12(Q4)、15(Q5)、16(Q6)、19(Q7)立即呈現輸入腳3、4、7、8、13、

3、14、17、18的狀態.鎖存端LE由高變低時，輸出端8位信息被鎖存，直到LE 端再次有效。當三態門使能信號OE為低電平時，三態門導通，允許Q0Q7輸出，OE為高電平時，輸出懸空。L低電平；H高電平；X不定態；Q0建立穩態前Q的電平;G輸入端，與8031ALE連高電平：暢通無阻低電平：關門鎖存。圖中OE使能端，接地。當G=“1”時，74LS373輸出端1Q8Q與輸入端1D8D相同;當G為下降沿時，將輸入數據鎖存。3 實現方法（含實現思路、程序流程圖、實驗電路圖和源程序列表等）四實驗結果分析（含執行結果驗證、輸出顯示信息、圖形、調試過程中所遇的問題及處理方法等） 當74LS373的控制端LE由高電平到低電平時，鎖存數據。2. 從寄存器里讀數據實驗擴展1. 實驗電路2. 寫數據電路2. 讀數據電路5. 實驗總結 通過本次實驗，我了解了通用寄存器的組成和硬件電路。做實驗之前，由以前學的理論知識明白寄存器

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