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文檔簡介

第六章可編程邏輯器件

6.3可編程邏輯陣列(PLA)

和可編程陣列邏輯(PAL)主講人:黃麗亞6.3.1PLA的結構和應用PLA的基本結構

I2I1I0O2O1O0與陣列(可編程)或陣列(可編程)與陣列或陣列A3A2A1A0D3D2D1D0例:試用PLA實現4位二進制碼到Gray碼的轉換。解:利用卡諾圖化簡得最簡與或式:時序型PLA基本結構圖PLA的與或陣列只能構成組合邏輯電路,若在PLA中加入觸發器則可構成時序型PLA,實現時序邏輯電路。與陣列或陣列······X1Xn觸發器······Z1ZmW1WlQkQ1······例:試用PLA和JK觸發器實現2位二進制可逆計數器。當X=0時,進行加法計數;X=1時,進行減法計數。解:X為控制信號,Y為進位(借位)輸出信號。X/YQ2Q10011100/01/01/11/01/00/00/10/001①畫狀態圖③求狀態、驅動和輸出方程比較得激勵方程:④畫陣列圖1J>C11K1J>C11KX1CPQ1Q2YI2I1I0O2O1O0與陣列(可編程)或陣列(固定)6.3.2PAL的結構與應用PLA與陣列和或陣列都可編程,限制了PLA的速度,于是應運而生了PAL,與陣列(可編程)和或陣列(固定)。

不同種類的PAL的輸出和反饋電路不同:專用輸出結構可編程輸入/輸出結構寄存器輸出結構異或輸出結構6.3.2PAL的結構與應用

專用輸出結構&&≥1≥1特點:或非門輸出或互補輸出PAL10H8(10輸入,8輸出,高電平輸出有效)、PAL10L8、PAL16C1(16輸入,1輸出,互補型輸出)??删幊梯斎?輸出結構≥1

這種結構的或門輸出經過三態輸出緩沖器,可直接送往輸出,也可再經互補輸出的緩沖器反饋到與陣列輸入。即它既可作為輸出用,也可作為輸入用。用于實現復雜的組合邏輯電路。寄存器輸出結構&≥1增加了DFF,整個PAL的所有DFF共用一個時鐘和輸出使能信號??蓸嫵赏綍r序邏輯電路PAL16R4、PAL16R8(R表示寄存器輸出型)異或輸出結構&&=1

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