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IntroductiontoMicroelectronicsThirdEdition《微電子概論》（第3版）郝躍賈新章史江一5.4.2半定制設(shè)計(jì)方法5.4專用集成電路設(shè)計(jì)方法5.4.1全定制設(shè)計(jì)方法目錄5.4.3可編程邏輯設(shè)計(jì)方法全定制設(shè)計(jì)優(yōu)點(diǎn)：針對(duì)每個(gè)器件進(jìn)行針對(duì)性設(shè)計(jì)與優(yōu)化，達(dá)到最優(yōu)的PPA效果針對(duì)設(shè)計(jì)任務(wù)指標(biāo)，采用人機(jī)交互方式對(duì)集成電路結(jié)構(gòu)、邏輯、電路、版圖等各個(gè)層次進(jìn)行精心設(shè)計(jì)。工程師需要針對(duì)目標(biāo)任務(wù)完成電路的集體管參數(shù)設(shè)計(jì)、版圖物理設(shè)計(jì)與優(yōu)化等工作對(duì)于數(shù)字電路，多用于小規(guī)模電路、關(guān)鍵模塊（如ALU）、單元電路等，用于追求極致的性能或者功耗等場(chǎng)合對(duì)于模擬電路，電路性能與器件參數(shù)關(guān)聯(lián)性較強(qiáng)，較多采用全定制設(shè)計(jì)缺點(diǎn)：設(shè)計(jì)效率低下，強(qiáng)烈依賴工程師個(gè)人能力全定制設(shè)計(jì)對(duì)于混合信號(hào)電路，數(shù)模銜接部分可采用全定制設(shè)計(jì)方法，比如ADC/DAC，Serdes，RapidIO等常見需要全定制設(shè)計(jì)的數(shù)字電路有：邏輯單元電路、存儲(chǔ)器單元、IO單元電路全定制電路人工工作量大，對(duì)布局等強(qiáng)烈依賴經(jīng)驗(yàn)，迭代緩慢，容易出錯(cuò)，可實(shí)現(xiàn)規(guī)模有限；在數(shù)字設(shè)計(jì)集中，多數(shù)采用更高抽象層次、基于單元的半定制設(shè)計(jì)方法，通過EDA工具實(shí)現(xiàn)大規(guī)模的電路設(shè)計(jì)。全定制電路設(shè)計(jì)流程通常采用模塊化設(shè)計(jì)

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