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文檔簡介

1、實驗一 邏輯門電路一、 與非門邏輯功能的測試74LS20（雙四輸入與非門）仿真結果輸 入輸出電壓（V）輸出邏輯狀態ABCDY000051000151001151011151111100二、或非門邏輯功能的測試74LS02（四二輸入或非門）仿真結果：輸 入輸出電壓（V）輸出邏輯狀態ABY0051010010001100三、與或非門邏輯功能的測試74LS51（雙二、三輸入與或非門）仿真結果：輸 入輸 出ABCDY0000100011001100111011110四、異或門邏輯功能的測試74LS86（四二輸入異或門）各一片仿真結果：輸 入輸 出ABY000011101110二、思考題1. 用一片74

2、LS00實現Y = A+B的邏輯功能 ；2. 用一片74LS86設計一個四位奇偶校驗電路；實驗二 組合邏輯電路一、 分析半加器的邏輯功能輸 入輸 出ABSCO0000011010101101二. 驗證三線-八線譯碼器的邏輯功能S1S2S3A2A1A0Q0Q1Q2Q3Q4Q5Q6Q7011111111111111111110000001111111100001101111111000101101111110001111101111100100111101111001011111101110011011111101100111111111103. 驗證數據選擇器的邏輯功能4.思考題（1）用兩片74

3、LS138接成四線-十六線譯碼器00000001011110001111（2）用一片74LS153接成兩位四選一數據選擇器；（3）用一片74LS153一片74LS00和接成一位全加器（1）設計一個有A、B、C三位代碼輸入的密碼鎖（假設密碼是011），當輸入密碼正確時，鎖被打開（Y1=1），如果密碼不符，電路發出報警信號（Y2=1）。以上四個小設計任做一個，多做不限。還可以用門電路搭建實驗三 觸發器及觸發器之間的轉換1. D觸發器邏輯功能的測試(上升沿)仿真結果;CPDSdRdQQ××11001××10101××10110×&

4、#215;01110××0001DCPQn+1Qn=0Qn=1011010011100011101111110112. JK觸發器功能測試（下降沿）Q=0Q=0略JKCPQn+1Qn=0Qn=10011011001010111011001001011011001111111011001103. 思考題：（1）（2）（3）略實驗四 寄存器與計數器1.右移寄存器（74ls74 為上升沿有效）2.3位異步二進制加法，減法計數器（74LS112 下降沿有效）也可以不加數碼顯示管3.設計性試驗（1）74LS160設計7進制計數器（74LS160 是上升沿有效，且異步清零，同步置數）若采用異步清零：若采用同步置數：（2）74LS160設計7進制計數器 略（3）24進制83進制注意：用74LS160與74LS197、74LS191是完全不一樣的實驗五 555定時

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