微機原理與接口技術西安郵電大學計算機學院范琳——80x86微處理器第三章80x86微處理器

80x86微處理器簡介18086微處理器28086寄存器38086引腳功能48086存儲器組織58086微處理器的引腳功能

8086微處理器是Intel公司的第三代微處理器—16位微處理器，它采用40引腳的DIP(雙列直插)封裝。時鐘頻率有3種：5MHz(8086)、8MHz(8086-1)和10MHz(8086-2)。

1.引腳功能說明

8086的40條引腳信號按功能可分為4部分—地址總線、數據總線、控制總線以及其他(時鐘與電源)。第三章80x86微處理器

AB：20，DB：16VCC：1，GND：2，CLK：1CB？GND8086CPU12345678910111213141516171819202122232425262728293031323334353637383940AD14AD13AD12AD11AD10AD9AD8AD7AD6AD5AD4AD3AD2AD1AD0NMIINTRCLKGNDRESETREADYTEST)QS(INTA1ALE(QS0))S(DEN0)S(RDT1/)S(IOM2/)LOCK(WR)GT/RQ(HOLD0RDMX/MN7SBHE/A19/S6A18/S5A17/S4A16/S3AD15VCC(＋5V))GT/RQ(HLDA1GND8088CPU12345678910111213141516171819202122232425262728293031323334353637383940A14A13A12A11A10A9A8AD7AD6AD5AD4AD3AD2AD1AD0NMIINTRCLKGNDRESETREADYTEST)QS(INTA1ALE(QS0))S(DEN0)S(R/DT1)S(M/IO2)LOCK(WR)GT/RQ(HOLD0RDMX/MN)HIGH/(SS0A19/S6A18/S5A17/S4A16/S3A15VCC(＋5V))GT/RQ(HLDA1第三章80x86微處理器

8086CPU12345678910111213141516171819202122232425262728293031323334353637383940AD14AD13AD12AD11AD10AD9AD8AD7AD6AD5AD4AD3AD2AD1AD0A19/S6A18/S5A17/S4A16/S3AD15地址總線和數據總線（20條）AD15

AD0為地址／數據總線，A19

A16／S6

S3為地址／狀態總線。其中：數據總線用來在CPU與內存儲器(或I／O設備)之間交換信息，為雙向、三態信號；地址總線由CPU發出，用來確定CPU要訪問的內存單元(或I／O端口)的地址信號，為輸出、三態信號。第三章80x86微處理器

8086CPU12345678910111213141516171819202122232425262728293031323334353637383940GNDCLKGNDV(＋5V)CC電源地線及時鐘CLK：時鐘信號(輸入)。該信號為8086CPU提供基本的定時脈沖，其占空比為1∶3(高電平持續時間：重復周期＝1∶3)，以提供最佳的內部定時。

Vcc：電源(輸入)，要求接上正電壓(+5V±10％)。GND：地線、兩條接地線。第三章80x86微處理器

控制總線（16條）

控制總線是傳送控制信號的一組信號線，有些是輸出線，用來傳輸CPU送到其他部件的控制命令(如讀、寫命令，中斷響應等)；有的是輸入線，由外部向CPU輸入控制及請求信號(復位、中斷請求等)。

第三章80x86微處理器

8086CPU12345678910111213141516171819202122232425262728293031323334353637383940RESETMX/MN工作方式和RESETRESET：輸入，為高時，CPU執行復位；MN/MX：工作方式控制，高電平為最小工作方式，單CPU工作，低電平為最大工作方式，多處理器合作。第三章80x86微處理器

8086CPU12345678910111213141516171819202122232425262728293031323334353637383940NMIINTR)QS(INTA1中斷相關的引腳NMI：非屏蔽中斷請求信號，不受flags中中斷允許標志位IF的影響；INTR：可屏蔽中斷請求信號，如果有效，再查看IF信息；INTA：中斷響應信號，對于INTR信號做出響應；第三章80x86微處理器

8086CPU12345678910111213141516171819202122232425262728293031323334353637383940READY)S(IOM2/)LOCK(WRRD讀寫內存的信號RD：讀控制信號；WR：寫控制信號；M/IO：指出當前訪問的是存儲器還是I/O接口。低：I/O接口，高：內存；READY：表示數據準備好的信號，CPU在T3狀態查詢該信號，如果有效，說明數據已經準備好，否則插入若干個等待狀態Tw；當WR=1，RD=0，M/IO=1時，表示CPU當前正在

。第三章80x86微處理器

8086CPU12345678910111213141516171819202122232425262728293031323334353637383940最小工作方式BHE/S7：高8位數據總線允許信號；低，表示高8位有效，高：表示低8位有效；ALE：地址鎖存信號；在T1結束的時候，ALE由高向低跳變時鎖存。高：AB地址有效；DT/R：三態，輸出。數據傳送方向，高：CPU輸出，低：CPU輸入；DEN：三態，輸出。低電平時，表示DB上的數據有效；ALE(QS0))S(DEN0)S(RDT1/7SBHE/第三章80x86微處理器

8086CPU12345678910111213141516171819202122232425262728293031323334353637383940TEST)GT/RQ(HOLD0)GT/RQ(HLDA1其余引腳HOLD：總線請求信號，當8086CPU之外的總線主設備要求占用總線時，通過該引腳向CPU發送一個高電平；HLDA：總線請求相應信號